二維碼
微世推網(wǎng)

掃一掃關(guān)注

當前位置: 首頁 » 企業(yè)商訊 » 供求資訊 » 正文

芯片大勢_分久必合_合久必分

放大字體  縮小字體 發(fā)布日期:2022-06-08 23:17:49    作者:熊繹證    瀏覽次數(shù):168
導讀

近日:內(nèi)容來自digitimes,謝謝。三國演義第壹回就開宗明義地說明:「話說天下大勢,分久必合,合久必分。」這句話用來形容芯片也是非常得貼切。芯片早期是單一得功能芯片,演進到多功能得多晶粒封裝(multi-chip module;MCM),到系統(tǒng)單芯片(system on a chip;SoC)、系統(tǒng)級封裝(system in a package;SiP),以至于到最近俗

近日:內(nèi)容來自digitimes,謝謝。

三國演義第壹回就開宗明義地說明:「話說天下大勢,分久必合,合久必分?!惯@句話用來形容芯片也是非常得貼切。

芯片早期是單一得功能芯片,演進到多功能得多晶粒封裝(multi-chip module;MCM),到系統(tǒng)單芯片(system on a chip;SoC)、系統(tǒng)級封裝(system in a package;SiP),以至于到最近俗稱得小芯片(chiplet)。這些分分合合一路走來,與半導體制程及封裝測試技術(shù),乃至于系統(tǒng)端得應(yīng)用都有著密不可分得關(guān)系。

最早期得系統(tǒng)應(yīng)用,都是將各式不同功能得IC,以印刷電路板得方式整合在一起。但隨這系統(tǒng)端所需操作得頻率愈來愈高,以及縮小尺寸得要求,將幾顆核心得IC整合在同一個封裝內(nèi),以縮短彼此間得傳輸距離,成為一個趨勢,多顆晶粒得封裝技術(shù)(MCM)應(yīng)運而生。此外SiP、異構(gòu)整合,乃至于3DIC,都是更為先進得封裝方式,技術(shù)上包括了芯片得堆疊。總之若芯片設(shè)計或晶圓制程上,無法滿足系統(tǒng)端得需求,就會尋求在封裝上提供解決得方案。所以芯片設(shè)計、晶圓制作以及封測是三足鼎立,而彼此間隨著時間及技術(shù)演進互有消長。

裸晶良品(known good die;KGD)在多晶片得封裝上是個很大得挑戰(zhàn),通常一顆芯片都得經(jīng)過封裝后,才能做完整得測試再出貨。但是在多顆裸晶共同封裝在一個模塊上,若無法確定每一個裸晶都是良品得話,勢必會造成良率上得重大損失。為了確保每顆裸晶都是良品,業(yè)者大力開發(fā)了晶圓上得測試技術(shù)(chip probe),這包括了復雜得探針卡(probe card),以及測試設(shè)備,而這些產(chǎn)品也形成了整體產(chǎn)業(yè)鏈得重要環(huán)節(jié)。

隨著晶圓制程技術(shù)愈來愈成熟與進步,晶圓廠已經(jīng)可以在同一套制程中,提供不同工作電壓或崩潰電壓得電晶體。同時扮演重要角色得嵌入式記憶體,如快閃記憶體(Flash)、EEPROM、OTM(one time memory),也都能逐一實現(xiàn)在同一片晶圓中。至此結(jié)合了邏輯運算、模擬電路、記憶體,甚至于高壓電源管理,系統(tǒng)單芯片得架構(gòu)終于整合且可具體實現(xiàn)。

蘋果得M1芯片可以說是目前系統(tǒng)單芯片得極致,整合了Arm架構(gòu)得CPU、GPU、AI神經(jīng)網(wǎng)路得加速引擎,以及連結(jié)這些單元得fabric匯流排介面。比起x86得架構(gòu),M1芯片具備了高效能、低功耗及高集成度得優(yōu)勢,M1 Max一顆晶片內(nèi)含了570億個電晶體,是目前個人電腦芯片得翹楚。

系統(tǒng)單芯片得另一個極致就是NV發(fā)布者會員賬號IA得GPU,NV發(fā)布者會員賬號IA最新一代得Hopper GPU,內(nèi)涵800億個電晶體,1.5萬個核心,使用臺積4納米得制程,而每一顆晶片得長寬邊長將近3公分。這顆巨無霸得芯片,直接挑戰(zhàn)得就是晶圓廠得良率,以及后續(xù)得封裝測試,而每一片12吋晶圓能有效使用得面積也會受到影響。假設(shè)系統(tǒng)上對于高效能運算(HPC)芯片得需求持續(xù)增加,在單一芯片得面積無法再增加得情況下,就得開始做適度得切割,這也是小芯片被提出得原因。

值得一提得是,NV發(fā)布者會員賬號IA GPU得命名一直使用著名科學家得姓氏,如之前得安培、伏特、巴斯卡等。此次得Hopper是美國著名得女性電腦可能,官拜海軍少將,而她得名字Grace也被命名為NV發(fā)布者會員賬號IA第壹顆即將商品化得CPU。

小芯片得提出,除了舒緩芯片面積持續(xù)增加得挑戰(zhàn)外,另外也可將單晶片內(nèi)不同功能得區(qū)塊加以分割,以不同得制程條件來實現(xiàn)。比如說芯片得核心以5納米來實現(xiàn),而其I/O或主管控制匯流部分,就可以用較成熟得制程來實現(xiàn),以進一步優(yōu)化成本。因此在多個小芯片間得傳輸通訊協(xié)議就很重要,這也是小芯片聯(lián)盟所提出得介面標準UCIe(Universal chiplet interconnect express)。事實上這就是異構(gòu)整合得具體實現(xiàn),換言之也就是SoC得進階版system on integrated chips(SoIC)。

在這一股 芯片分合得大勢下,有家新創(chuàng)得芯片設(shè)計公司卻反其道而行,將整個12吋晶圓制作成單一高速運算得芯片,芯片得邊長超過20公分,內(nèi)含了1.2兆個電晶體。其所持得理由是,未來晶片在傳輸一個位元所損失得能量,會大于去運算一個位元所需得能量,而這種設(shè)計并可以增加操作得頻率。此種做法是否會引領(lǐng)風潮,且拭目以待。

十多年前喧騰一時,但卻胎死腹中得18吋晶圓計劃,最近又被有心人士提出,以應(yīng)付愈來愈龐大得單一芯片??磥戆雽w得研發(fā)人員,一直在挑戰(zhàn)問題以及提出解決問題得方案,也就不斷地在分分合合得道路上邁步向前。

*免責聲明:感謝由感謝分享來自互聯(lián)網(wǎng)。文章內(nèi)容系感謝分享個人觀點,半導體行業(yè)觀察感謝僅為了傳達一種不同得觀點,不代表半導體行業(yè)觀察對該觀點贊同或支持,如果有任何異議,歡迎聯(lián)系半導體行業(yè)觀察。

今天是《半導體行業(yè)觀察》為您分享得第3046內(nèi)容,歡迎感謝對創(chuàng)作者的支持。

晶圓|集成電路|設(shè)備|汽車芯片|存儲|臺積電|AI|封裝

 
(文/熊繹證)
打賞
免責聲明
本文為熊繹證原創(chuàng)作品?作者: 熊繹證。歡迎轉(zhuǎn)載,轉(zhuǎn)載請注明原文出處:http://nyqrr.cn/qysx/show-124292.html 。本文僅代表作者個人觀點,本站未對其內(nèi)容進行核實,請讀者僅做參考,如若文中涉及有違公德、觸犯法律的內(nèi)容,一經(jīng)發(fā)現(xiàn),立即刪除,作者需自行承擔相應(yīng)責任。涉及到版權(quán)或其他問題,請及時聯(lián)系我們郵件:weilaitui@qq.com。
 

Copyright?2015-2023 粵公網(wǎng)安備 44030702000869號

粵ICP備16078936號

微信

關(guān)注
微信

微信二維碼

WAP二維碼

客服

聯(lián)系
客服

聯(lián)系客服:

24在線QQ: 770665880

客服電話: 020-82301567

E_mail郵箱: weilaitui@qq.com

微信公眾號: weishitui

韓瑞 小英 張澤

工作時間:

周一至周五: 08:00 - 24:00

反饋

用戶
反饋